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Verilog/HDLbits

[HDLBits] Inverter

1. 문제 및 설명

NOT gate 모듈을 만드세요

 

 

2. 모듈 정의

module top_module( input in, output out );

 

 

 

3. 답

module top_module( input in, output out );
	assign out = !in;
endmodule

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